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SystemVerilogによるモデリングと論理合成 : ハードウェア記述言語による回路設計の基礎

篠塚一也著. -- 共立出版, 2026. <BB00277104>
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SystemVerilogによるモデリングと論理合成 : ハードウェア記述言語による回路設計の基礎

篠塚一也著. -- 共立出版, 2026. <BB00277104>
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所蔵一覧 1件～1件（全1件）

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No. 巻号 所蔵館 配置場所 請求記号 資料ID 状態 返却予定日 予約
0001 図書館 2階 549.7||S 004806238 書架 0件
No. 0001
巻号
所蔵館 図書館
配置場所 2階
請求記号 549.7||S
資料ID 004806238
状態 書架
返却予定日
予約 0件
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書誌詳細

標題および責任表示 SystemVerilogによるモデリングと論理合成 : ハードウェア記述言語による回路設計の基礎 / 篠塚一也著
System Verilog ニ ヨル モデリング ト ロンリ ゴウセイ : ハードウェア キジュツ ゲンゴ ニ ヨル カイロ セッケイ ノ キソ
出版・頒布事項 東京 : 共立出版 , 2026.1
形態事項 xii, 227p : 挿図 ; 26cm
巻号情報
ISBN 9784320125926
その他の標題 奥付タイトル:RTL modeling and logic synthesis with SystemVerilog
注記 表現種別: テキスト (ncrcontent), 機器種別: 機器不用 (ncrmedia), キャリア種別: 冊子 (ncrcarrier)
注記 参考文献: p[224]-225
学情ID BD14535781
本文言語コード 日本語
著者標目リンク 篠塚, 一也||シノズカ, カズヤ <AU00098210> 著者
分類標目 電子工学 NDC9:549.7
分類標目 電子工学 NDC10:549.7
分類標目 科学技術 NDLC:ND386
分類標目 電子工学 NDC10:549.3
件名標目等 ハードウェア記述言語||ハードウェアキジュツゲンゴ
件名標目等 回路設計||カイロセッケイ
件名標目等 ハードウェア記述言語||ハードウェアキジュツ ゲンゴ
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